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合并电晶体逻辑电路
【合并电晶体逻辑电路】基础信息( 英文,繁体)
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合
并
电
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辑
电
路
繁体
合併電晶體邏輯電路
英文
merged transistor logic circuit
【合并电晶体逻辑电路】是什么意思
将两个或更多个印刷电路合并成一个逻辑电路。
来源:-- 资讯与通信术语辞典
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