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闸位准逻辑模拟

【闸位准逻辑模拟】基础信息（英文,繁体）

词语闸位准逻辑模拟
繁体閘位準邏輯模擬
英文gate level logic simulation

【闸位准逻辑模拟】是什么意思

利用计算机验证设计中的数位系统的逻辑正确性的一种方法。模拟的输入是逻辑图和检验码等,模拟的结果输出是检验码在逻辑图中某些检测点上所形成的波状图。对输出结果进行分析可确定逻辑是否正确。

来源：-- 资讯与通信术语辞典

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